在实际的电路系统中,芯片的输入阻抗---,因此对单电阻形式来说,负载端的并联电阻值必须与传输线的特征阻抗相近或相等。假定传输线的特征阻抗为50ω,则r值为50ω。如果信号的高电平为5v,则信号的静态电流将达到100ma。由于典型的ttl或cmos电路的驱动能力很小,这种单电阻的并联匹配方式很少出现在这些电路中。
上可知当“讯号”在传输线中飞驰旅行而到达终点,欲进入接受元件(如cpu或meomery等大小不同的ic)中工作时,则该讯号线本身所具备的“特性阻抗”,惠普500绘图仪厂家,必须要与终端元件内部的电子阻抗相互匹配才行,如此才不致任务失败白忙一场。
例如浇花的软管突然被踩住,惠普500绘图仪厂家,造成软管两端都出现异常,惠普500绘图仪,正好可说明上述特性阻抗匹配---的问题。4.3 阻抗匹配---造成杂讯。上述部分讯号能量的反弹,将造成原来---品质的方波讯号,立即出现异常的变形(即发生高准位向上的overshoot
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